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IEEE embedded systems letters (2010)
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Multi-Optical Network-on-Chip for Large Scale MPSoC
Sébastien Le Beux1, Jelena Trajkovic2, Ian O'Connor1, Gabriela Nicolescu3, Guy Bois4, Pierre Paulin5

Optical Network on Chip (ONoC) architectures are emerging as promising contenders to solve bandwidth and latency issues in multiprocessor systems-on-chip (MPSoC). However, current on-chip integration technologies for optical interconnect allow interconnecting only dozens of IPs. Scaling with MPSoCs composed of hundreds of IPs thus, relies on unpredictable technological innovations. In this letter, we propose a method that combines multiple ONoCs. Each ONoC is small enough to rely on already existing and proven technologies. We evaluate the approach on various interconnect scenarios, showing that it scales well with the size of MPSoC architectures.
1 :  INL - Institut des nanotechnologies de Lyon - Site d'Ecully
2 :  GR2M - Groupe de recherche en microélectronique et microsystèmes
3 :  EPM - Ecole Polytechnique de Montreal
4 :  GR2M - Groupe de recherche en microélectronique et microsystèmes
5 :  STMicroelectronics